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- 确认芯片内部的电平转换，如果没有的话 压差可能导致时序不收敛
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- AXI 总线outstanding的处理，可能没考虑
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- delay太大导致buffer （vnne sram<-> vnne ddr）
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- npu时序收敛
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- AXI总线满载仿真
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